免费获取|
论文天下网
  • 论文天下网 |
  • 原创毕业论文 |
  • 论文范文 |
  • 论文下载 |
  • 计算机论文 |
  • 论文降重 |
  • 毕业论文 |
  • 外文翻译 |
  • 免费论文 |
  • 开题报告 |
  • 心得体会 |

当前位置:论文天下网 -> 论文下载 -> 电子信息工程

基于FPGA的多路抢答器的设计

本文ID:16337 字数:13592,页数:37

下载地址 全文下载链接(充值:¥128.00元) 

点击下载:下载地址 基于FPGA的多路抢答器的设计 (收费:12800 积分)  如何获取积分?

论文编号:DZXX106  论文字数:13592,页数:37

摘要

 现场可编程门阵列FPGA作为集成度和复杂程度最高的可编程ASIC。是ASIC的一种新型门类,它建立在创新的发明构 思和先进的 EDA技术之上。传统的数字逻辑设计使用 TTL电平和小规模的数字集成电路来完成逻辑电路图。使用这些标准的逻辑器件已经被证实是最便宜的手段,但是要求做一些布线和复杂的电路集成板(焊接调试)等工作,如果出现错误,改动起来特别麻烦。正是因为 FPGA的EDA技术使用了更高级的计算机语言,电路的生成基本上是由计算机来完成,将使用户能较快地完成更复杂的数字电路设计,由于没有器件之间的物理连接,因此调试及故障排除更迅速、有效。
 本文运用 EDA中的 Ouartus II作为软件开发平台,设计了一款基于 FPGA的智力竞赛抢答器。

关键词:现场可编程门阵列,EDA技术,电路生成

ABSTRACT

 Field programmable gate array FPGA as the highest level of integration and complexity of programmable ASIC. ASIC is a new type of categories, it is built on innovative ideas and inventions on advanced EDA technologies. Traditional digital logic design using TTL level and small-scale digital integrated circuits to complete the logic circuit. Use these standard logic devices have been proved to be the cheapest means, but asked to do some wiring and complex integrated circuit board (solder debugging), etc., if there is an error, change up special problems. Because the EDA FPGA technology uses a more advanced computer language, the circuit is essentially generated by the computer to complete, allow users to quickly complete the more complex digital circuit design, because there is no physical connection between Qi Jian, Therefore, debugging and troubleshooting more quickly and effectively.
 In this paper, the Ouartus II EDA as a software development platform, designed a FPGA-based quiz Responder.

 Keywords: Field programmable gate array, EDA technology, circuit generates
目录

摘要 I
ABSTRACT II
第一章 引言 1
 1.1 背景 1
 1.2 研究内容 1
第二章  硬件设计 3
 2.1 传统智力抢答器设计 3
 2.2 设计思路与系统结构 4
 2.2.1 功能模块划分 4
 2.2.2 功能分析 4
 2.3 FPGA技术 4
 2.3.1 FPGA的基本特点 5
 2.3.2 FPGA的配置模式 6
 2.4 外部电路 6
第三章 软件设计 11
 3.1 开发软件 11
 3.2 设计思路 12
 3.3 各个模块及整体功能的实现 12
 3.3.1 判别锁存模块 14
 3.3.2 译码显示模块 14
 3.3.3 时钟分频模块 15
 3.3.4 计时与声光模块 16
 3.4 各个模块的时序仿真图 17
 3.4.1 lock模块时序仿真图及其分析 17
 3.4.2 decoder模块时序仿真图及其分析 18
 3.4.3 counter模块时序仿真图及其分析 18
 3.4.4 bell模块时序仿真图及其分析 19
 3.4.5 dsp模块时序仿真图及其分析 19
 3.4.6 三个分频模块说明 20
第四章 系统调试 21
第五章 结束语 23
致 谢 24
参考文献 25
附录 源代码 26

相关论文
上一篇:温、湿度测量系统设计与实现 下一篇:染缸温度水位控制系统设计
推荐论文 本专业最新论文
Tags:基于 FPGA 路抢答 设计 2011-03-31 08:50:18【返回顶部】

相关栏目

教育管理论文
汉语言文学
学前教育论文
心理学论文
小学教育论文
现代教育技术
数学与应用数学
数学教育论文
工商管理
人力资源管理
财务会计
法律论文
行政管理论文
物流专业论文
电子商务论文
理工科论文
物理学论文
乡镇企业管理
电视制片管理
文化产业管理
物业管理论文
毕业论文下载
包装工程论文
印刷工程论文
工业工程论文
信息管理论文
生物工程论文
制药工程论文
电子信息工程
通信工程论文
电气工程论文
信息计算科学
药学专业毕业论文


关于我们 | 联系方式 | 论文说明 | 网站地图 | 免费获取 | 钻石会员 | 原创毕业论文

 

论文天下网提供论文检测,论文降重,论文范文,论文排版,网站永久域名WWW.GEPUW.NET

本站部分文章来自网友投稿上传,如发现侵犯了您的版权,请联系指出,本站及时确认并删除  E-mail: 893628136@qq.com

Copyright@ 2009-2022 GEPUW.NET 论文天下网 版权所有